news 2026/7/19 10:44:09

TMS320F2838x I2C驱动开发：从协议原理到Driverlib实战

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张小明

前端开发工程师

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TMS320F2838x I2C驱动开发：从协议原理到Driverlib实战

1. 项目概述与I2C总线核心价值

在嵌入式系统开发，尤其是工业控制、电机驱动和新能源领域，我们经常需要让微控制器与多个低速外设“对话”，比如读取温度传感器的数据、配置电源管理芯片的参数，或者从EEPROM中读取校准数据。如果每个外设都用一组独立的并行数据线连接，PCB布线会变得异常复杂，成本也会飙升。这时，I2C总线就成了工程师手中的“瑞士军刀”。

I2C，全称Inter-Integrated Circuit，是一种由飞利浦（现恩智浦NXP）公司设计的同步、多主多从、串行通信总线。它的精髓在于“极简主义”：仅凭两根线——串行数据线（SDA）和串行时钟线（SCL）——就能构建起一个设备网络。主设备发起通信并产生时钟，从设备响应主设备的寻址。这种设计极大地简化了硬件连接，特别适合板载设备间的短距离通信。

我手头正在使用的德州仪器（TI）的TMS320F2838x系列微控制器，是C2000™实时MCU家族中的高端成员，广泛应用于需要高性能计算和复杂控制的场景。其内置的I2C模块完全兼容I2C总线规范v2.1，并提供了丰富的增强功能，如16级深度的收发FIFO、灵活的中断机制以及对7位/10位寻址的支持。然而，直接从寄存器层面操作它，对于新手甚至是有经验的工程师来说，都像是在迷宫中摸索。官方提供的Driverlib库函数则像一张清晰的地图，将底层复杂的寄存器操作封装成直观的API。本文将结合我的实际项目经验，带你从I2C协议的本质出发，深入解析TMS320F2838x的I2C模块，并手把手教你如何使用Driverlib高效、稳定地开发驱动。无论你是刚接触C2000的新手，还是想优化现有通信代码的老手，这篇文章都将提供从原理到实践的完整路径。

2. I2C总线协议深度解析与TMS320F2838x硬件适配

2.1 I2C协议基础：不止是两根线那么简单

很多人对I2C的第一印象就是SDA和SCL两根线，加上开漏输出和上拉电阻。但这只是物理层。要真正用好它，必须理解其链路层的“语言规则”。

核心信号与状态：

  • 起始（S）与停止（P）条件：这是总线仲裁和通信帧的边界。起始条件是SCL为高时，SDA线一个从高到低的跳变；停止条件则是SCL为高时，SDA线从低到高的跳变。总线在S之后、P之前被视为“忙”（BB=1）。在F2838x中，通过设置I2CMDR寄存器的STT和STP位来生成这些条件。这里有一个关键细节：模块在复位状态（IRS=0）时无法检测总线状态。因此，在初始化使能模块（IRS置1）后，必须等待一段时间（超过系统中最长单次传输时间），让模块捕捉到一次真实的S或P条件，才能通过BB位正确判断总线空闲状态，否则可能引发总线冲突。
  • 数据有效性：协议规定，SDA线上的数据必须在SCL为高电平期间保持稳定，数据的变化只能发生在SCL为低电平期间。这为接收方提供了稳定的采样窗口。F2838x的I2C模块内部集成了噪声滤波器，正是为了确保在SCL高电平期间采样的数据是干净的。
  • 应答（ACK）与非应答（NACK）：每个字节（8位）传输后，接收方必须发出一个应答时钟脉冲。在这个脉冲期间，发送方释放SDA线，接收方将SDA线拉低表示应答（ACK），保持高电平则表示非应答（NACK）。这是I2C通信可靠性的基石。主设备收到NACK通常意味着从设备无响应或传输结束。

寻址模式： F2838x的I2C模块支持两种寻址模式，由I2CMDR寄存器的XA位控制：

  1. 7位地址模式（XA=0）：最常用的模式。起始条件后的第一个字节，高7位为从机地址，最低位是R/W方向位（0写，1读）。
  2. 10位地址模式（XA=1）：用于连接更多设备。地址分两字节发送：第一个字节为11110xx（其中xx为10位地址的最高两位）+ R/W位；第二个字节为地址的低8位。从机需对每个地址字节都进行应答。10位寻址的流程更复杂，通常用于系统规模较大的场合。

工作模式： 模块有四种基本操作模式，由自身是主/从以及数据流向共同决定：

  • 主发送（Master-Transmitter）：主设备向从设备写数据。
  • 主接收（Master-Receiver）：主设备从从设备读数据。
  • 从接收（Slave-Receiver）：从设备接收主设备发来的数据。
  • 从发送（Slave-Transmitter）：从设备向主设备发送数据。

模式切换并非随意。例如，一个从设备初始为从接收模式，只有在被主设备寻址且R/W位为1时，才能切换到从发送模式。

2.2 TMS320F2838x I2C模块的独特优势与时钟配置

F2838x的I2C模块并非一个简单的协议控制器，它针对实时控制系统的需求做了大量优化。

时钟系统详解： 模块的时钟生成是正确通信的前提。如图33-3所示，时钟路径分为两级分频：

  1. 模块时钟（Module Clock）：由系统时钟SYSCLK经过预分频器（I2CPSC寄存器）产生。公式为Fmod = SYSCLK / (I2CPSC + 1)。关键点：I2C协议对时序有严格要求，为确保满足所有建立/保持时间，模块时钟频率必须配置在7-12 MHz之间。预分频器只有在模块复位状态（IRS=0）时配置才有效，配置完后置位IRS=1启用模块，新频率生效。
  2. 主时钟（SCL线时钟）：当模块作为主设备时，模块时钟会进一步分频以产生SCL线上的通信时钟。这里的分频由两个寄存器控制：I2CCLKL（低电平时间）和I2CCLKH（高电平时间）。SCL周期Tmst = Tmod * [(ICCH + d) + (ICCL + d)]，其中d是一个与IPSC值相关的延迟常量（见手册表33-1）。通过精细调节ICCH和ICCL，可以精确控制SCL的频率和占空比，以适应不同从设备的速度要求（标准模式100kbps，快速模式400kbps）。

FIFO与中断增强： 模块集成了16x8位的独立收发FIFO，这是提升CPU效率的关键。

  • 发送FIFO：CPU可以一次性写入多个数据到I2CDXR（或通过Driverlib的FSI_writeTxBuffer），模块会自动从FIFO中取出并发送，减少了CPU频繁中断的负担。
  • 接收FIFO：模块接收到的数据先存入FIFO，CPU可以定期或在中断触发后批量读取。
  • 中断机制：模块支持两组中断源，可通过ePIE模块上报给CPU：
    • I2C INT：处理核心事件，如发送数据就绪（XRDY）、接收数据就绪（RRDY）、仲裁丢失（ARD）、无应答（NACK）等。
    • I2C FIFO INT：专门处理FIFO事件，如发送FIFO为空、接收FIFO达到可编程水位线。合理配置FIFO中断可以大幅优化数据吞吐效率。

开漏输出与上拉电阻： 模块的SDA和SCL引脚配置为开漏输出，这是实现“线与”功能的基础。这意味着外部必须接上拉电阻到VDDIO。电阻值的选择至关重要：太小则电流过大，太大则上升沿过慢，可能导致时序违规。TI的应用报告《I2C Bus Pullup Resistor Calculation》提供了详细的计算方法。一个经验值是，在3.3V系统、标准模式下，通常使用2.2kΩ至4.7kΩ的电阻。务必确保SDA和SCL的上拉电阻值匹配。

3. 基于Driverlib的I2C驱动开发实战

直接操作寄存器不仅容易出错，而且代码可读性和可维护性差。TI提供的Driverlib库将寄存器操作封装成函数，是我们的首选。下面我将以主设备模式、7位地址、读写一个I2C传感器为例，展示完整的驱动开发流程。

3.1 硬件与软件环境初始化

硬件连接检查：

  1. 确认F2838x的I2C引脚（例如，I2CA_SDA, I2CA_SCL）已通过GPIO MUX正确映射到物理引脚。
  2. 测量SDA和SCL线上拉到电源（如3.3V）的电阻，确保在2.2kΩ左右。
  3. 用示波器或逻辑分析仪观察总线，确保在空闲状态下SDA和SCL均为高电平。

软件初始化步骤： 初始化顺序很重要，错误的顺序可能导致模块无法工作或总线锁死。

#include "driverlib.h" #include "device.h" // 假设使用I2C-A模块，目标从机地址为0x48 (7位) #define I2C_SLAVE_ADDR 0x48 void I2C_Master_Init(void) { // 步骤1: 使能I2C模块的时钟（假设在SysCtl中配置） SysCtl_enablePeripheral(SYSCTL_PERIPH_CLK_I2CA); // 步骤2: 配置GPIO引脚为I2C功能，并禁用输入量化（异步模式） // 注意：GPIO的ODR（开漏）寄存器必须设置为普通模式，开漏功能由I2C模块内部管理 GPIO_setPinConfig(GPIO_24_I2CA_SDA); GPIO_setPadConfig(24, GPIO_PIN_TYPE_OD); // 配置为开漏，但模块会管理 GPIO_setQualificationMode(24, GPIO_QUAL_ASYNC); // 异步输入，避免毛刺 GPIO_setPinConfig(GPIO_25_I2CA_SCL); GPIO_setPadConfig(25, GPIO_PIN_TYPE_OD); GPIO_setQualificationMode(25, GPIO_QUAL_ASYNC); // 步骤3: 复位并初始化I2C模块 I2C_disableModule(I2CA_BASE); // 先禁用模块（IRS=0） SysCtl_delay(1000); // 短暂延时 // 步骤4: 配置I2C时钟（关键！） // 假设SYSCLK = 200MHz，目标模块时钟Fmod = 10MHz (在7-12MHz范围内) // I2CPSC = SYSCLK / Fmod - 1 = 200/10 - 1 = 19 I2C_initMaster(I2CA_BASE, DEVICE_SYSCLK_FREQ, 100000, I2C_DUTYCYCLE_50); // 注意：此函数内部已计算并设置了I2CPSC、I2CCLKL、I2CCLKH，目标SCL为100kHz，占空比50% // 步骤5: 使能I2C模块（拉高IRS位） I2C_enableModule(I2CA_BASE); // 步骤6: 等待总线空闲（必须！） // 模块刚使能时BB位可能不准确，等待远长于一次传输的时间 SysCtl_delay(10000); // 延时约10ms，远大于400kbps下传输一帧的时间 while(I2C_isBusBusy(I2CA_BASE) == true) { // 如果总线一直忙，可能是外部设备拉低，需要排查硬件 // 此处可加入超时处理 } // 步骤7: 配置FIFO（可选但推荐） I2C_enableFIFO(I2CA_BASE); // 使能FIFO功能 I2C_setFIFOInterruptLevel(I2CA_BASE, I2C_FIFO_TX4, I2C_FIFO_RX4); // 设置TX FIFO<=4时触发中断，RX FIFO>=4时触发中断 // 步骤8: 配置并启用中断（如果需要） I2C_clearInterruptStatus(I2CA_BASE, I2C_INT_ALL); I2C_enableInterrupt(I2CA_BASE, I2C_INT_ARB_LOST | I2C_INT_NACK | I2C_INT_STOP_COND); I2C_enableInterrupt(I2CA_BASE, I2C_INT_RX_FIFO | I2C_INT_TX_FIFO); // 在PIE向量表中注册中断服务函数... }

注意：I2C_initMaster这个Driverlib函数非常方便，但它内部的计算是基于理想模型的。在极端温度或电压下，实际的SCL频率可能会漂移。对于时序要求极其苛刻的从设备，建议手动计算并配置I2CPSC、I2CCLKL和I2CCLKH寄存器，并通过示波器实测校准。

3.2 主设备读写操作完整流程

我们以向地址0x48的传感器写入一个配置寄存器（寄存器地址0x01，写入数据0xAA），然后再从该寄存器读回数据为例。

主发送（写操作）流程：

bool I2C_Master_Write(uint16_t slaveAddr, uint16_t regAddr, uint8_t *pData, uint16_t dataSize) { uint16_t i; bool result = false; // 步骤1: 设置从机地址（7位模式） I2C_setSlaveAddress(I2CA_BASE, slaveAddr); // 步骤2: 设置为发送器模式（主设备将要发送数据） I2C_setMode(I2CA_BASE, I2C_MODE_MASTER_SEND); // 步骤3: 设置要发送的数据字节数（寄存器地址1字节 + 数据dataSize字节） I2C_setDataCount(I2CA_BASE, 1 + dataSize); // 步骤4: 将数据放入发送FIFO（先放寄存器地址，再放数据） I2C_putData(I2CA_BASE, regAddr); // 写入寄存器地址 for(i = 0; i < dataSize; i++) { I2C_putData(I2CA_BASE, pData[i]); } // 步骤5: 发送起始条件，并自动在计数结束后发送停止条件 // I2C_MODE_MASTER_SEND + 设置数据计数 + 启动，构成“非重复模式”传输 I2C_sendStartCondition(I2CA_BASE); // 步骤6: 等待传输完成（通过ARDY中断或轮询） // 方法A: 轮询ARDY位（非重复模式，计数到0时置位） while(I2C_getInterruptStatus(I2CA_BASE) & I2C_INT_ARB_READY) == 0) { // 可加入超时处理，防止死等 if(timeout_expired()) { I2C_sendStopCondition(I2CA_BASE); // 超时则强制停止 return false; } } I2C_clearInterruptStatus(I2CA_BASE, I2C_INT_ARB_READY); // 步骤7: 检查是否有NACK或仲裁丢失错误 uint16_t status = I2C_getStatus(I2CA_BASE); if((status & I2C_STAT_NACK) != 0) { // 从机无应答，处理错误 I2C_clearStatus(I2CA_BASE, I2C_STAT_NACK); return false; } if((status & I2C_STAT_ARB_LOST) != 0) { // 仲裁丢失，处理错误 I2C_clearStatus(I2CA_BASE, I2C_STAT_ARB_LOST); return false; } result = true; return result; }

主接收（读操作）流程： 读操作需要先发送寄存器地址（写操作），然后发送重复起始条件（Repeated Start），再切换为接收模式读取数据。这是I2C标准复合格式的典型应用。

bool I2C_Master_Read(uint16_t slaveAddr, uint16_t regAddr, uint8_t *pData, uint16_t dataSize) { bool result = false; // === 第一阶段：发送寄存器地址（主发送模式）=== I2C_setSlaveAddress(I2CA_BASE, slaveAddr); I2C_setMode(I2CA_BASE, I2C_MODE_MASTER_SEND); I2C_setDataCount(I2CA_BASE, 1); // 只发送1个字节（寄存器地址） I2C_putData(I2CA_BASE, regAddr); I2C_sendStartCondition(I2CA_BASE); // 发送起始条件 // 等待第一阶段发送完成（ARDY） while((I2C_getInterruptStatus(I2CA_BASE) & I2C_INT_ARB_READY) == 0) { if(timeout_expired()) { return false; } } I2C_clearInterruptStatus(I2CA_BASE, I2C_INT_ARB_READY); // === 第二阶段：重新起始，并读取数据（主接收模式）=== // 注意：这里不发送停止条件，而是直接发送重复起始条件 I2C_setMode(I2CA_BASE, I2C_MODE_MASTER_RECEIVE); I2C_setDataCount(I2CA_BASE, dataSize); // 设置要读取的字节数 // 对于读操作，在接收最后一个字节前，主设备应发送NACK // Driverlib的I2C_setMode在接收模式下默认会在最后一个字节发送NACK // 发送重复起始条件，开始读传输 I2C_sendStartCondition(I2CA_BASE); // 等待数据接收完成 uint16_t wordsRemaining = dataSize; while(wordsRemaining > 0) { // 可以轮询RRDY中断，或使用FIFO接收中断 if(I2C_getRxFIFOStatus(I2CA_BASE) != 0) { // FIFO中有数据 *pData++ = I2C_getData(I2CA_BASE); wordsRemaining--; } if(timeout_expired()) { I2C_sendStopCondition(I2CA_BASE); return false; } } // 等待整个传输序列完成（ARDY再次置位） while((I2C_getInterruptStatus(I2CA_BASE) & I2C_INT_ARB_READY) == 0) { if(timeout_expired()) { I2C_sendStopCondition(I2CA_BASE); return false; } } I2C_clearInterruptStatus(I2CA_BASE, I2C_INT_ARB_READY); // 发送��止条件，结束本次通信 I2C_sendStopCondition(I2CA_BASE); result = true; return result; }

3.3 FIFO与中断的高效应用

在实时控制系统中，CPU时间非常宝贵。使用FIFO和中断可以避免CPU轮询等待，实现“后台”通信。

FIFO配置技巧：

void I2C_ConfigureFIFO_ForEfficiency(void) { // 使能FIFO I2C_enableFIFO(I2CA_BASE); // 设置FIFO中断触发水位线 // TXFFIL: 发送FIFO深度为16，设为4表示当FIFO中数据<=4时触发TX中断，提醒CPU补充数据 // RXFFIL: 接收FIFO深度为16，设为12表示当FIFO中数据>=12时触发RX中断，提醒CPU及时取走数据，防止溢出 I2C_setFIFOInterruptLevel(I2CA_BASE, I2C_FIFO_TX4, I2C_FIFO_RX12); // 启用FIFO中断 I2C_enableInterrupt(I2CA_BASE, I2C_INT_TX_FIFO | I2C_INT_RX_FIFO); }

中断服务函数（ISR）示例：

__interrupt void i2cA_FIFO_ISR(void) { uint32_t status = I2C_getInterruptStatus(I2CA_BASE); // 处理发送FIFO中断（空间可用） if(status & I2C_INT_TX_FIFO) { // 检查当前发送是否还有数据要填充 if(g_txDataRemaining > 0) { uint16_t i; // 一次性填充尽可能多的数据到FIFO，直到FIFO满或数据用完 for(i = 0; i < g_txDataRemaining; i++) { if(I2C_isTxFIFOFull(I2CA_BASE)) { break; } I2C_putData(I2CA_BASE, g_txBuffer[g_txIndex++]); g_txDataRemaining--; } } else { // 所有数据已放入FIFO，可禁用TX FIFO中断，等待ARDY中断表示全部发送完成 I2C_disableInterrupt(I2CA_BASE, I2C_INT_TX_FIFO); } I2C_clearInterruptStatus(I2CA_BASE, I2C_INT_TX_FIFO); } // 处理接收FIFO中断（数据达到水位线） if(status & I2C_INT_RX_FIFO) { // 从FIFO中批量读取数据 while(I2C_getRxFIFOStatus(I2CA_BASE) != 0) { // FIFO非空 g_rxBuffer[g_rxIndex++] = I2C_getData(I2CA_BASE); } // 如果接收计数已满，可禁用RX FIFO中断 if(g_rxIndex >= EXPECTED_RX_SIZE) { I2C_disableInterrupt(I2CA_BASE, I2C_INT_RX_FIFO); } I2C_clearInterruptStatus(I2CA_BASE, I2C_INT_RX_FIFO); } // 处理其他关键中断，如NACK、仲裁丢失 if(status & I2C_INT_NACK) { // 记录错误，执行恢复操作（如发送停止条件，重新初始化） I2C_sendStopCondition(I2CA_BASE); g_i2cErrorFlags |= NACK_ERROR; I2C_clearInterruptStatus(I2CA_BASE, I2C_INT_NACK); } // 必须清除PIE组应答位 Interrupt_clearACKGroup(INTERRUPT_ACK_GROUP8); }

4. 高级功能配置与疑难问题深度排查

4.1 重复模式（Repeat Mode）与DMA结合的应用

在某些流式数据传输场景（如连续读取ADC值），重复模式（I2CMDR.RM = 1）非常有用。在此模式下，数据传输不会在预定的字节数后自动停止，而是持续进行，直到软件主动发送停止条件或新的起始条件。这允许传输任意长度的数据流。

配置重复模式进行连续读取：

void I2C_Master_Continuous_Read(uint16_t slaveAddr, uint16_t startReg, uint8_t *buffer, uint32_t totalSize) { // 1. 发送起始地址（标准非重复模式写） I2C_setSlaveAddress(I2CA_BASE, slaveAddr); I2C_setMode(I2CA_BASE, I2C_MODE_MASTER_SEND); I2C_setDataCount(I2CA_BASE, 1); I2C_putData(I2CA_BASE, startReg); I2C_sendStartCondition(I2CA_BASE); while((I2C_getInterruptStatus(I2CA_BASE) & I2C_INT_ARB_READY) == 0); // 2. 配置为重复模式，并切换为主接收 I2C_setMode(I2CA_BASE, I2C_MODE_MASTER_RECEIVE); I2C_enableRepeatMode(I2CA_BASE); // 设置RM位 // 3. 启动DMA，将I2C接收数据寄存器（I2CDRR）与DMA通道关联 // 假设使用DMA通道1，触发源为I2CA_RX DMA_configMode(DMA_CH1_BASE, DMA_TRIGGER_I2CA_RX, DMA_MODE_CONTINUOUS); DMA_configAddress(DMA_CH1_BASE, (uint32_t)&I2CA_BASE->I2CDRR, (uint32_t)buffer, totalSize); DMA_enableChannel(DMA_CH1_BASE); // 4. 发送重复起始条件，开始连续读取 I2C_sendStartCondition(I2CA_BASE); // 此时不会自动停止 // 5. DMA会在每次I2C收到数据后自动搬运，CPU被解放 // ... 等待DMA完成中断或轮询DMA状态 ... // 6. 数据传输完成后，由软件发送停止条件 I2C_sendStopCondition(I2CA_BASE); I2C_disableRepeatMode(I2CA_BASE); }

注意：重复模式下，I2CCNT寄存器的值被忽略。ARDY中断会在每个字节传输完成后产生，而不是在所有数据传输完成后。这为实时处理每个字节提供了可能，但也对CPU或DMA的响应速度提出了更高要求。

4.2 常见问题排查与实战经验

在实际项目中，I2C通信失败是家常便饭。以下是我总结的排查清单和应对策略。

问题1：总线锁死，SCL线被持续拉低。

  • 现象：用示波器或逻辑分析仪测量，SCL线始终为低电平，总线无法恢复。
  • 根本原因：这是I2C通信中最常见也最棘手的问题。通常发生在从设备在接收或发送完一个字节后，等待CPU干预（如读取I2CDRR或写入I2CDXR），但CPU未能及时响应，导致从设备一直拉低SCL线（时钟延展）。
  • 解决方案：
    1. 软件恢复：在初始化序列或看门狗中断中，尝试发送多个时钟脉冲“踢”开总线。代码上可以临时将SCL引脚配置为GPIO输出，手动产生9个以上的时钟脉冲，然后再恢复为I2C功能。
    2. 硬件监控：设计一个硬件看门狗电路，当SCL低电平超过一定时间（如10ms）后，通过一个MOS管或模拟开关强制拉高SCL线一小段时间。
    3. 预防措施：确保中断响应及时，FIFO水位线设置合理，避免CPU被长时间阻塞。在从机模式下，尤其要确保I2CDRR被及时读取（RSFULL=1时）或I2CDXR被及时写入（XSMT=0时）。

问题2：通信随机失败，伴随NACK错误。

  • 现象：间歇性出现NACK状态位被置位，通信中断。
  • 排查步骤：
    1. 电源与上拉：首先检查从设备电源是否稳定，SDA/SCL上拉电阻值是否合适（用万用表测量电压，空闲时应为VDD）。在高速模式下，过大的上拉电阻会导致上升沿过缓，违反时序。
    2. 时序分析：使用逻辑分析仪捕获失败的通信帧。重点检查：
      • 启动条件：SDA下降沿前，SCL高电平保持时间是否足够？
      • 数据建立/保持时间：SDA数据在SCL上升沿前（建立时间）和下降沿后（保持时间）是否稳定？
      • 时钟频率：实测SCL频率是否超出从设备支持的最大值（特别是400kHz快速模式）？
    3. 地址与ACK：确认发送的从机地址（含R/W位）完全正确。有些设备有多个地址选择引脚（A0, A1），需要核对硬件连接。
    4. 软件顺序：检查是否在总线忙（BB=1）时尝试发起传输？务必在I2C_enableModule后等待并确认BB=0。

问题3：使用Driverlib函数I2C_initMaster后，SCL时钟频率不准。

  • 原因：I2C_initMaster内部使用整数分频计算，可能无法精确得到目标频率。此外，公式中的延迟常量d（见表33-1）也会引入误差。
  • 解决方法：对于时钟精度要求高的应用，手动计算并配置寄存器。
    void I2C_Master_Manual_Config(uint32_t sysClkFreq, uint32_t i2cClkFreq) { uint32_t prescaler; uint32_t moduleClk; uint16_t icch, iccl; uint16_t d = 5; // 假设IPSC>1 // 1. 计算预分频值，使模块时钟在7-12MHz范围内 prescaler = (sysClkFreq / 10000000) - 1; // 目标10MHz if(prescaler < 0) prescaler = 0; moduleClk = sysClkFreq / (prescaler + 1); // 2. 计算ICCH和ICCL，得到目标SCL频率 (例如100kHz) // SCL周期 = Tmod * [(ICCH+d) + (ICCL+d)] // 目标SCL周期 = 1 / 100000 = 10us // Tmod = 1 / moduleClk // 假设占空比50%，则 (ICCH+d) ≈ (ICCL+d) uint32_t totalDiv = (moduleClk / i2cClkFreq); // 模块时钟周期数 per SCL周期 uint32_t halfDiv = (totalDiv / 2) - d; // 减去延迟d icch = iccl = (halfDiv > 0xFFFF) ? 0xFFFF : (uint16_t)halfDiv; // 防止溢出 // 3. 手动配置寄存器 I2C_disableModule(I2CA_BASE); I2C_setPrescaler(I2CA_BASE, prescaler); I2C_setClockLow(I2CA_BASE, iccl); I2C_setClockHigh(I2CA_BASE, icch); I2C_enableModule(I2CA_BASE); // ... 等待总线空闲 }
    配置完成后，务必用示波器测量SCL的实际频率和占空比，并微调icch和iccl值。

问题4：多主竞争与仲裁丢失。

  • 现象：在有多主机的系统中，自己的主机频繁触发仲裁丢失（ARD中断）。
  • 分析：仲裁是I2C多主机的核心机制。当多个主机同时发起传输时，它们会继续发送数据直到出现分歧。发送“1”（释放总线）而另一个主机发送“0”（拉低总线）的节点会丢失仲裁，并立即切换到从机模式，监听获胜主机发出的地址。
  • 应对：仲裁丢失不是错误，是正常机制。在中断服务程序中，检测到I2C_STAT_ARB_LOST后，应：
    1. 清除状态位。
    2. 将自身模式切换回主机发送/接收（如果需要）。
    3. 等待总线空闲（BB=0）。
    4. 重新发起传输。驱动程序应能优雅地处理重试，例如加入指数退避算法避免连续冲突。

问题5：从机模式下无法正确响应自身地址。

  • 检查清单：
    1. 从机地址寄存器（I2COAR）：确认写入的地址是否正确（7位地址左移一位？）。10位地址模式需要正确配置I2CMDR.XA位。
    2. 模块使能：确保IRS位已置1。
    3. 中断使能：如果使用中断方式，需使能“被寻址为从机”（AAS）相关中断。
    4. FIFO模式：在从机模式下，FIFO同样工作。确保FIFO已使能，并且TX FIFO中有数据可供发送（从发送模式时），或RX FIFO有空间接收数据。

通过以上系统的解析、实战代码和问题排查指南，你应该能够驾驭TMS320F2838x上复杂的I2C模块，并构建出稳定、高效的通信链路。记住，理解协议是基础，善用工具（逻辑分析仪）是关键，而严谨的代码和充分的错误处理则是项目成功的保障。

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作者头像 李华
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