-mode out_of_context 导出edf write_verilog -mode synth_stub D:/Project/spec_check/end/prj_check_v2/user/edf/data1_gen.v 这里不要求 write_edif -security_mode all D:/Project/spec_check/end/prj_check_v2/user/edf/data1_gen.edf 注意这里的名称要和模块名一致
news
2026/2/25 3:17:11
172.vivado封装edf文件
张小明
前端开发工程师
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2026/2/17 19:06:06
华三交接机HCL实验中二层交换的链路聚合
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