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工业RS-485模块怎么才能一次做对？我在Altium Designer里踩过的那些坑
去年冬天调试一个智能电表集抄网关，现场连续三天通信丢帧。用示波器抓到RS-485总线A/B线上叠加着300mVpp的共模毛刺——不是干扰源的问题，是我们自己的PCB把电源噪声耦合进去了。返工改板前，我重新翻了一遍Altium Designer的设计规则、信号完整性设置和隔离边界处理逻辑。这一次，我把整个流程拆解成三个不可割裂的环节：差分走线必须“形神兼备”、隔离边界必须“寸土不让”、EMC对策必须“见招拆招”。下面分享的，不是教科书定义，而是我在十几个工业通信模块中反复验证过的做法。
差分对不是画两条线那么简单：从SN65HVD75说起
我们选TI的SN65HVD75，不是因为它便宜，而是它在12Mbps下仍能保持±250mV的最小差分输出（VOD），且共模抑制比（CMRR）实测达78dB——这对长线多节点场景太关键了。但参数再好，布线一塌糊涂，照样变“废片”。
先说个反直觉的事实：差分对的等长，远不如紧耦合重要。很多工程师花大力气绕蛇形线让A/B长度误差控制在5mil以内，却把两根线拉得相距0.5mm，结果眼图张开度直接掉30%。为什么？因为松散耦合削弱了互感抵消效应，共模噪声更容易转化成差模干扰。
在AD里怎么做？
第一步
